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2用4位二进制同步加法计数器74161构成的计数器电路如图所示,则对该计数器应用电路功能描述正确的是
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2考虑到触发器的触发特性,用构成异步二进制加法计数器应最简单。 A.T’触发器 B.T触发器
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2用T触发器设计N位同步二进制加法计数器电路,则第i(N-1≥i≥1)位触发器的驱动方程Ti构成表达
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2设计模值为89的十进制计数器至少需要级触发器。 A.8 B.7 C.6 D.5
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3在异步时序逻辑电路的设计中,选定触发器类型之后,还要为每个触发器选定()。
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4在设计稳定性和工作频率要求较高的中大规模时序系统时一般采用同步时序电路来设计。 A.正确 B.
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3下列有关异步时序逻辑电路的特点说法正确的是: A.异步时序逻辑电路所有触发器的CP端并不是统一动
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3分析下图所示的同步时序逻辑电路,其电路功能描述正确的是。 A.当A=0时,该时序逻辑电路为同步四
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1某电路的状态转换表如下所示,则其状态转换图正确的是。 A. B. C. D.
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1时序逻辑电路如图1所示,则图1所示电路的状态方程正确的是。 A. B. C. D.以上均不
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3在下列器件中,不属于时序逻辑电路的是。 A.移位寄存器 B.数据选择器 C.寄存器 D.计
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21判断凡是结构形式上由两个同步触发器级联而成,且它们的时钟信号CP相位相反的触发器均为主从触发器。
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16多选JK触发器功能很强,辅以简单设计,它就能够实现以下触发器的逻辑功能。 A.D触发器 B.
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11多选下列触发器有可能发生空翻现象。 A.同步D触发器 B.同步JK触发器 C.同步RS触发
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7单选已知R、S是2个与非门构成的基本RS触发器的输入端,则约束条件为。 A.R+S=1 B.R
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3单选主从JK型触发器是 A.输出与CP无关的 B.在CP上升沿输出信号 C.在CP=1的稳态
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4下图所示电路的逻辑功能是。 A.8进制异步计数器 B.8进制同步计数器 C.7进制异步计数器
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4同一逻辑功能的触发器可以用不同的电路结构实现。 A.正确 B.错误
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4列能够构成T’触发器的是:。 A.J=K=1 B.R=1,S=0 C.J=K=T D.D=
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3用CMOS边沿触发器和异或门组成如下电路,则输出Z与CP脉冲的频率之比为:。 A.1:1 B.
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